Questa ADMS
AMS SoC設計においては、アナログ・コンテンツとデジタル・コンテンツがこれまでになくタイトに組み合わされています。これらの設計は、PLL、電圧レギュレータ、アダプティブ・フィルタなどの各種アナログブロックに大きく依存するようになっています。このような統合レベルの高まりは、設計者にとって大きなプレッシャーとなります。従来の設計ツールを使ったフローでは、アナログ/デジタル・サブシステムを別々に開発せざるを得なかったため、これらのコンポーネントの統合はICレイアウトの段階まで遅れることとなり、テストは製造後に行われました。Questa ADMSがリリースされる以前のAMS SoC設計は、低速で、エラーの起こりやすいプロセスでした。
高性能、ハイ・キャパシティのアナログ/ミックスシグナル・シミュレーション
Questa ADMSは、定評あるQuesta検証プラットフォームの一元的なシミュレーション環境を維持しつつ、アナログ/ミックスシグナルの標準言語を加えて拡張したものです。ADMSは特定の言語に依存しないので、1つの設計の中にVHDL-AMS、Verilog-AMS、VHDL、Verilog、SystemVerilog、SPICE、SystemCをどのようなレベルでも自由に混在させることができます。
また、Questa ADMSにはミックスシグナルの結果を表示および解析するための機能として、汎用性に優れたEZwaveミックスシグナル波形ビューアと波形計算ツールが用意されています。
統合
Questa ADMSは、メンター・グラフィックスのDesign Architect-ICと統合されており、Questa ADMSの高度なモデル登録/選択機能とDA-ICのシミュレーション・コックピットおよびメンター・グラフィックスの高速な階層型ネットリスタを組み合わせて利用できます。Design Architect-ICは短期間で容易に習得でき、メンター・グラフィックスのカスタムIC設計フローの他のツールにもシームレスに統合します。
Questa ADMSはCadence Virtuoso Analog Design Environmentにも統合でき、Questa ADMSならではの高度な解析機能、コマンド、オプションを同環境の他のシミュレータと同じルック&フィールで利用できます。特定のEldoデバイスを提供する強化されたシンボル・ライブラリは、Cadenceのライブラリと互換性があります。
Questa ADMSとICanalyst CBを補完的に組み合わせると、最新のミックスシグナルSoCで求められる複雑な検証ストラテジを管理することができます。
Questa ADMSは、完全なプリント基板の機能検証を行うメンター・グラフィックスのHyperLynx Analogにもシミュレーション・エンジンとして採用されています。1つの図面でPCBレイアウトと機能解析の両方をサポートします。HyperLynx AnalogとHyperLynx SIを組み合わせると、寄生PCBトレース・モデルを抽出してボードレベルの完全な機能解析を行うことができます。
特長と利点
- 数百万ゲート規模のAMS SoC設計に対するトップダウン設計とボトムアップ検証が可能
- 言語とシミュレーション・アルゴリズムの組み合わせを設計者が自由に選択可能
- 豊富な実績で業界をリードするシミュレーション技術を組み合わせ、幅広い言語をサポートすることで時間短縮と生産性向上を実現
- メンター・グラフィックスのDA-ICおよびCadenceのAnalog Design Environmentに統合された設計フローにより、過去の設計資産を有効に活用
- 高レベルおよびシステム・レベル設計、アーキテクチャ探索の機能を強化。短期間でのビヘイビア・モデリング手法の学習が可能
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データシート
- Questa ADMS (PDF, 928KB)
ツールボックス
- 技術文献 : Bluetoothトランシーバの設計: 複雑なRFミックスシグナルICに対するトップダウン設計フローの適用
- 技術文献 : ADVance MSとCommLib SerDesを利用したPCI Express 2.5Gbps SerDesのビヘイビアモデル作成と検証方法
- ソフトウェア評価 : Questa ADMS評価リクエスト [英語]
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