Vista

高度なプラットフォームアーキテクチャパッケージ

Vistaは、アーキテクチャ設計の探索、検証、仮想プロトタイピングを目的とした完全なTLM 2.0ベースのソリューションです。システムアーキテクトやSoC設計者は最適なアーキテクチャを決定できるようになり、ハードウェアエンジニアとソフトウェアエンジニアは設計サイクルの早期にハードウェア/ソフトウェアの妥当性を確認できるようになります。複雑なシステムのプロトタイプ作成、デバッグ、解析をRTL段階に先立って行うことにより、設計プロセスの予測性と生産性を向上させ、初回での成功を実現します。Vistaソリューションポートフォリオの詳細

ネットワーキングやストレージシステム、マルチコアSoCの複雑化が急速に進む中、アーキテクチャ決定の重要性がますます大きくなっており、競合製品に対する優位性に直接影響を及ぼすようになっています。マルチコアのハードウェア/ソフトウェアアーキテクチャと通信ファブリックの仕組みを適切に構成し、システムを負荷や要求されるデータトラフィックに対応させることは重要なタスクです。

Vistaには、トップダウン方式のモデリング、パラメータ化が容易なアーキテクチャブロックセット、直感的に分かりやすいグラフィカルなアセンブリプラットフォーム、およびハードウェア/ソフトウェアのデバッグ/解析ツールセットが用意されています。

システムを構成するモデルは、さまざまなマイクロアーキテクチャ構成、インターコネクトレイヤ、メモリ階層へと直感的にセットできます。Vistaはレイヤ方式の画期的なタイミングアプローチを採用しており、機能を維持したまま、強力なタイミングポリシーを使ってさまざまな構成を短時間で検証できます。このアプローチにより、ユーザは高位近似モデルからターゲットバスおよびプロトコルレベルまで、タイミングと消費電力の精度を幅広く、そしてきめ細かく調整できます。また、複雑なデータオブジェクト(データパケット)を利用し、IDによるタグ付けを行い、システム内における伝搬をトレースして解析できるなど、データのトレースも効率的に行うことができます。

統計的データトラフィックやランダム化されたデータトラフィックのシミュレーション、あるいはターゲットプロセッサを使用したソフトウェア駆動のシミュレーションを実行することも可能です。

Vistaには強力な解析ツールセットが付属しており、さまざまな性能指標や消費電力指標を直感的に表示/解析できるほか、任意のポート、バス、サブシステムについて負荷のピーク、平均レイテンシ、スループット、占有率などを確認できます。

Vistaのユーザは、主要なハードウェアブロックを使ってシステムのプロトタイプを短時間で作成し、さまざまなシナリオやトラフィック負荷に対して消費電力や性能を解析できます。Vistaではスケーラブルなモデリングアプローチがサポートされるため、設計チームはコンセプトの段階から目標とする実装が得られるまでタイミングと消費電力を管理できます。これによりシリコンを最適化し、特定のアプリケーションに対応できるデータ許容量を確保すると同時に、将来の派生製品についてもスケーラブルなサポートが可能になります。

特長と利点

利点

  • 性能や消費電力の指標を早期段階で評価
  • リスクを最小限に抑え、最大限の品質を達成
  • コンセプト段階から実装まで、タイミングとパワーバジェットのバランスのとれた管理
  • 重要なスケーリングアルゴリズムのプロパティを理解
  • デターミニスティックなスケーラビリティ

特長

  • TLM 2.0ベースの構成変更可能なアーキテクチャブロックセット: CPU、BUS(AXI、AHB)、メモリ、キャッシュ、DMAC、INTCほか
  • 統計的および機能的な先行モデリングユーティリティ
  • データパケットおよびモデルの状態/属性のトレース機能
  • TLM 2.0ベースのグラフィカルなアセンブリ
  • ターゲットプロセッサとソフトウェアツールを統合したHW/SWプラットフォーム
  • SystemCとTLM 2.0に対応した高度なデバッグおよびトレース機能
  • 高度な解析/可視化ツールとレポート
  • 消費電力、スループット、レイテンシ、占有率、ステートを解析

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