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IC設計Calibre nmDRC/eqDRCの概要
プロセスが微細化されるにつれて、より物理現象を考慮した複雑な検証が必要になってきました。このWebセミナーでは、この問題に対処すべく、高精度な検証を効率よく既存のデザイン・フローへ導入するためのヒントをご紹介します。
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技術文献
IC設計自動DRC疑似エラー管理
Calibre DRC Automatic WaiversによってIPに含まれる疑似エラーの心配を解消！
サードパーティのIP（知的財産）を設計に統合したときに常にIC設計者が直面するのは「時空の罠」とも言うべきものです。真のデザイン・ルール・チェック（DRC）違反ではないとしてファウンドリによって除外された違反（疑似エラー）が、統合後のICを検証したときに再び出現するからです。IC設計者にとっては、こうした疑似エラーもほかのエラーと同様に多大な工数とサイクル時間を使って解析し、解決する以外に選択肢がありません。
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Events｜すべて表示- PCB設計ソフトウェア&ツール JISSO PROTEC 2012（同時開催: JPCA Show 2012） 6/13 - 6/15: 東京ビッグサイト 東展示棟, 東京
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- 熱流体解析および熱抵抗測定 T3Ster User Forum Japan 5/11: メンター・グラフィックス・ジャパン株式会社, 東京
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- メンター・グラフィックスのMentor Embedded LinuxがYocto Projectをサポートし、Linuxおよびオープンソース開発のさらなる簡素化を実現 （2012年03月28日）